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SuperSimpleController（その２３）VDPSG基板の改版　 [OriginalCPU]

　前回の記事で自作CPUボード（Simple8Z）用に作成したサブボード（Simple8Vdpsg）でPSG（AY-3-8910）を使った自動演奏について書きましたが、Simple8Vdpsgボードがうまく動いているようなので回路図に修正部分を反映して整理しました。
　自分のためのメモの意味も込めて整理後の回路図などの情報を記録しておきたいと思います。

　初版の回路図は「SuperSimpleController（その１７）TMS9918Aの接続　その２」の記事に書いていますが、今回は下記の変更を行っています。

RCAジャックのフットプリントの変更
DRAMのOE/タイミングの調整
PSGの制御信号の見直し
PSGのBポートのコネクタ出力

　4項は初耳（初目？）だと思いますが、PSGはポート毎に入力／出力の設定ができるのでA/Bの両ポート共にコネクタに出力するようにしました。
　下図が修正した回路図になります。制御のためのコネクタ部はSIMPLE8というバスに準拠しており、Z-80等のCPUでも簡単に繋がるはずです。

修正後のSimple8Vdpsgの回路図

　　★変更　2021/09/18 Ver0.03　VDPのA9/端子をGNDに接続（修正反映漏れ^^;）,C12:100pF->0pF

　回路図の変更に伴いパターン図もアップデートしました。

Simple8Vdpsgのパターン図（グランドベタ化前）

　グランドベタ化後のトップ面とボトム面のパターン図が下図になります。

Simple8Vdpsgのパターン図（トップ面）

Simple8Vdpsgのパターン図（ボトム面）

　３Ⅾ表示した図も貼っておきます。

Simple8Vdpsg基板のＣＡＤによる３Ｄ表示

　また、今回はtwitter等で話題になっているALLPCBさんに基板製造を依頼しました。
　腹周りが2ｍくらいあるんじゃないかと思える太っ腹なクーポンにより初回の注文は輸送費も含めて只になります（7月に只クーポン使った人は8月にも只クーポンを貰えたらしい）

　注文時の設定画面が下図でMin Spacingに関しては、今回0.3mmで設計しmil換算では 11.8 mil(=0.3/(2.54/100))なので10milを選択しました。
　今回の設計ではビアの穴径を0.42mmにしたのでMin Hole Sizeを0.4mmにしています（CPU基板（Simple8Z）の方は高密度化のために0.3mmで設計しています）

ALLPCBでPCB製造注文時の設定例

　上記の設定値と価格との関連は未確認ですが、今回は下図の最初の行の「Order Now」ボタンを押すことで、クーポンを使った只の注文ができました。
　Order Time:2021/8/28 23:17:33 で現在（8/29 14：00）のステータスは Allpcb auditing（ALLPCBで監査中）です。
　出荷予定日は Estimated Shipping Time:2021/09/01 となっています。

ALLPCBでの注文形態選択一覧

★追記　2021/09/22
　製造依頼したプリント基板は9/4に届きました。ALLPCBさんでは毎月送料込みでの無料クーポンが発行されるようで9月分も発行されました。
　また、ALLPCBさんのサイトで今回のプリント基板製造工程の時刻が結構詳しく確認できたので貼っておきます。

No.	Process	Time(GMT+8)
1	Cutting	2021-08-30 T11:22
2	First Drilling	2021-08-30 T12:50
3	Copper Plating	2021-08-30 T18:41
4	Panel Plating	2021-08-30 T22:53
5	Dry Film Coating	2021-08-30 T23:30
6	Circuit Inspection	2021-08-31 T00:59
7	Etching	2021-08-31 T00:59
8	Etching Inspection	2021-08-31 T01:07
9	Solder Mask	2021-08-31 T01:08
10	Solder Mask Positioning	2021-08-31 T02:13
11	Solder Mask Positioning Inspection	2021-08-31 T03:35
12	Silk Screen	2021-08-31 T03:36
13	Surface Finishing	2021-08-31 T07:10
14	Testing	2021-08-31 T08:43
15	Profiling	2021-08-31 T10:45
16	FQC	2021-08-31 T13:07
17	Final Inspection	2021-08-31 T13:14
18	Packing	2021-08-31 T17:00

★追記　2021/09/23
　DHLでの配達記録も参考に貼っておきます。



     Time                      Operation
2021-09-01 13:34:00     Shipment picked up
2021-09-01 16:58:00     Processed at ZHEJIANG PROVINCE-CHN
2021-09-01 17:12:00     Departed Facility in ZHEJIANG PROVINCE-CHN
2021-09-01 17:19:04     Clearance processing complete at EAST CHINA AREA-CHN
2021-09-01 19:51:00     Arrived at Sort Facility EAST CHINA AREA-CHN
2021-09-02 00:27:00     Processed at EAST CHINA AREA-CHN
2021-09-02 01:22:00     Departed Facility in EAST CHINA AREA-CHN
2021-09-02 04:10:02     Customs status updated
2021-09-02 18:30:06     Customs status updated
2021-09-03 11:24:00     Arrived at Sort Facility TOKYO-JPN
2021-09-03 12:27:00     Clearance processing complete at TOKYO-JPN
2021-09-03 13:31:00     Processed at TOKYO-JPN
2021-09-03 13:33:00     Departed Facility in TOKYO-JPN
2021-09-03 14:12:00     Arrived at Delivery Facility in YOKOHAMA-JPN
2021-09-03 14:47:00     Forwarded for delivery
2021-09-04 07:15:00     Forwarded for delivery
2021-09-04 10:08:00     Delivered - Signed for by

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2021-08-29 14:10 nice!(0) コメント(0)
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SuperSimpleController（その２２）PSG(AY-3-8910A)の動作確認　その２　 [OriginalCPU]

　前回の記事でオリジナルCPU（Simple8Z)基板用に作成したサブボード（Simple8VDPSG)に実装したPSG(AY-3-8910)機能のハードディバッグ状況について書いたようにPSGが動くようになったので、今回はPSGを使って遊んでみた内容について書いてみます。

　PSG内のレジスタ構成は下表（マイクロチップ社のデータシートからの抜粋）のようになっています。レジスタ番号は8進数の表記でなので10進表記だとR0～R15の16個のレジスタがあります。

PSG register

　PSGのClock端子にはMSXと同様にVDPのCPUCLK出力（3.579545MHz）を2分周したもの(1.7897725MHz)を入れています。ロジアナで確認したクロック波形が下図になります。

PSGのクロック波形　サンプリング：100MHz

　PSG内で更に16分周した信号を各チャンネルの音程分周比レジスタ（R0～R5）に設定された値で分周した信号がトーン信号として出力されます。

　従って各音階を出力する場合のPSGの音程分周比は下表のようになります。
　表中の青色部分が4オクターブのラの音（440Hz）で、この値から指数演算（半音分が1/12乗）して下表の値を算出しています。ある行の次の行が１オクターブ高い（2倍の周波数）行になりますが、右シフト（x0.5）した値が下の行の値と一致しない場合があるのは小数点部分を四捨五入している為です。

oct	ド	ド#	レ	レ#	ミ	ファ	ファ#	ソ	ソ#	ラ	ラ#	シ
oct	C	C#	D	D#	E	F	F#	G	G#	A	A#	B
1	0D5C	0C9D	0BE7	0B3C	0A9B	0A02	0973	08EB	086B	07F2	0780	0714
2	06AE	064E	05F4	059E	054D	0501	04B9	0475	0435	03F9	03C0	038A
3	0357	0327	02FA	02CF	02A7	0281	025D	023B	021B	01FC	01E0	01C5
4	01AC	0194	017D	0168	0153	0140	012E	011D	010D	00FE	00F0	00E2
5	00D6	00CA	00BE	00B4	00AA	00A0	0097	008F	0087	007F	0078	0071
6	006B	0065	005F	005A	0055	0050	004C	0047	0043	0040	003C	0039

　Web上でPSGをエミュレートしているPSG Padというサイトがあり、PSGが動作するハードウェアが無くても気軽に動作を確認することができます。

　音階データの一覧表ができたので簡単な自動演奏をしてみたいと思います。
　ネット上には著作権の関係で楽譜のデータはあまりないのですが簡単移調楽譜屋というサイトでありがたいことに著作権が消滅した民謡・童謡・クラシック等の楽曲の楽譜を入手できます。その中にサイモンとガーファンクルで有名なスカボロフェアがあったので楽譜を入手しました。この曲は意外なことにイングランド民謡だったんですね。

　PSGで自動演奏しようとする際にエンベロープパターンを使ってピアノ音のようにしようと思ったのですが、エンベロープパターンは各チャンネル独立ではなく、1パターンを３チェンネルで共有しているので上手くいきません・・
　例えば、主旋律が無音時に対旋律を鳴らすと主旋律も鳴ってしまうのです^^;。

　そこで各トーンの音量をソフトで制御することにして、各チャンネルを独立したエンベロープで鳴らせるようにしました。
　今回の自作ＣＰＵにはタイマー割込み等は無いので音符長の処理内でエンベロープも処理するようにしています。

　各チャンネルで独立したエンベロープ処理ができれば、あとは音階データをPSGに流すだけで簡単に自動演奏ができます。

　スカボロフェアの演奏例を貼っておきます。今回作成したエンベロープ処理では初期音量も変更でき、この演奏例では主旋律と対旋律をそれぞれ二通りの音量（合計４種類）で制御しています。

再生できない場合、ダウンロードは🎵こちら

★追記　2021/08/25
　動画付きでtwitterに投稿したメッセージを貼っておきます。
　手持ちの小型LCDモニタでは色ずれしないのにNTSC信号をキャプチャしてパソコン画面に表示すると結構色ずれしてますね・・
　中華製の超安かったキャプチャだからかなぁ～

13個のDIP ICを使ったオリジナル8bit CPUを検討中
サブ基板に実装したPSGが動いたので自動演奏して遊んでみた
著作権が消滅したイングランド民謡であるスカボロフェア（なんと意外ですね）を演奏してみたよhttps://t.co/8kJ08CzbO9 #Simple8Z #VDPSG #AY38910 #OriginalCPU #自作CPU pic.twitter.com/Vu1ehlyuBt
— skyriver (@wcinp) August 25, 2021

★追記　2021/08/26
　動画を少し編集してYoutubeにアップしました。
https://www.youtube.com/watch?v=QoaBjz2VHSE

★追記　2021/08/27
　Youtubeで見つけた本物の「スカボローフェア」を貼っておきます。
　ボーカルに勝る楽器は無いということを思い知らされる気がします。すばらしぃ・・・
（中学の頃、姉が買ったサイモン＆ガーファンクルのLPをよく聞いてたなぁ）

　Simon and Garfunkel - Scarborough Fair Remastered study (HQ audio)

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タグ：TMS9918 Simple8Z TTL CPU OriginalCPU PSG 自作CPU オリジナルCPU Homebrew CPU AY-3-8910 Music Simple8VDPSG YouTube sound Twitter ツイッター

2021-08-25 18:01 nice!(0) コメント(0)
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SuperSimpleController（その２１）PSG(AY-3-8910A)の動作確認　 [OriginalCPU]

　前回の記事でオリジナルCPU（Simple8Z)基板用に作成したVDP(TMS9918），PSG(AY-3-8910）及びシリアル通信（MC68B50）を搭載したサブボード（Simple8VDPSG)のVDP機能が動いたことを書いたので今回はPSGの動作確認についてメモしておきます。

　このPSGはVDPSG基板を10cmｘ10cmにした場合、空きスペースが生じるので急遽付け足した機能で、ブレッドボード上での動作は未確認な状態でプリント基板化しています。

　PSGのA9/にはHC138からのPSGSEL/（PSGセレクト信号）を入れて、CPU基板からのRD/、WR/信号をPSGSEL/とANDしてPSGのBDIRとBC1に接続しています。
　BC2にはA0を接続していてどうにかなるだろうと思っていました（マニュアルをじっくり見ての検討をしていなかった^^;）

BDIR	BC2	BC1
PSGRD/	A0	PSGWR/

　PSGのバスコントロールは下表のように柔軟な設計になっていて（かえって紛らわしい）赤枠で囲んだ状態を使用して制御しようと思いました。

PSG Bus Control Function Table

　具体的なI/Oアドレスと制御方法は下表のような想定です。

No.	address	RD/WR	Function
1	21H	Read	read from PSG
2	20H	Write	latch address
3	21H	Write	write to PSG

　しかし、プリント基板の電源を入れてモニタでPSGのレジスタ設定しても全く動きません（設定したレジスタ値も読めません）^^;
　PSGへのクロックやコントロール信号は想定した通りに出ています・・・

　データシートをまじめに見て確認した結果、2つの問題があることが判りました。

【問題点と対策】

コントロール信号
　上記の「PSG Bus Control Function Table」を見るとBDIR,BC2,BC1が111の場合、LATCH ADDRESSの状態になります。この状態はPSGアクセス時以外でも発生するので不要なLATCH ADDRESSが発生してしまいます。

　ネット上でPSGを接続した回路例を探してみると、ほとんどの例がパラレルI/Oに接続してBUS CONTROLをソフト制御するようになっていました。しかし、回路を簡略化するためにもPSGを直接I/O命令で制御したいものです。
　WR/,RD/,A0の三つの信号で制御することにするとWR/とRD/はHC138でアドレスディコードしたPSGSEL/信号とANDするのでPSGアクセス以外では変化しませんが、A0の値は常に変化します。上記の「PSG Bus Control Function Table」からINACTIVEの状態をすべて列挙すると

No. BDIR BC2 BC1 Function

1 0 0 0 INACTIVE

2 0 1 0 INACTIVE

3 1 0 1 INACTIVE

となり、1,2のパターンを使ってBC2にA0を割り振るとA0はDon't careになり、PSGアクセス時以外で変化しても問題無くなります。
　PSGへのRDとWR信号をアクティブハイにすればPSGアクセス時以外では0になります。

　INACTIVE以外のBUS CONTROLを列挙したものが下表です。read/writeは１パターンしかないので下表の１，２のパターンは採用で決定で、LATCH ADDRESSは4のパターンを採用するとBDIRの値が"write to PSG"と同じになり辻褄が合うようになります。

No. BDIR BC2 BC1 Function

1 0 1 1 read from PSG

2 1 1 0 write to PSG

3 0 0 1 latch address

4 1 0 0 latch address

5 1 1 1 latch address

　結果としてPSGへのコントロール信号の接続は

BDIR BC2 BC1

PSGWR A0 PSGRD

となり、具体的なI/Oアドレスと制御方法は冒頭に書いたものと同様で下表のようになります。

No. address RD/WR Function

1 21H Read read from PSG

2 20H Write latch address

3 21H Write write to PSG
PSGのアクセスタイミング
　PSGへのアドレスラッチとデータ書込みタイミングを下図に示します。
　これを見るとBUS CONTROL自体が80系CPUにおける書込み信号（WR信号）でBUS CONTROLがINACTIVEに変化する際にDATAバス上のデータを取り込むようです。
　しかし現状の回路ではBUS CONTROLがINACTIVEになった時点でDATAバス上のデータも変化してしまいます。

PSG Latch Address Timing

PSG Write Data Timing

　対処としてはPSGSEL/に接続していたPSGのA9/をGNDへ接続するように変更し、「SuperSimpleController（その２０）TMS9918Aの接続　その５」の記事で対処したR1レジスタでアドレス指定するI/Oライト命令を使うことでBUS CONTROLがINACTIVEになった後も1クロック分、データバス上の書込みデータが保持されるようになります。

　以上の対処により、PSGのレジスタへの書込み／読込みができるようになり、トーン音やノイズ音が出力可能になりました。

No.	BDIR	BC2	BC1	Function
1	0	0	0	INACTIVE
2	0	1	0	INACTIVE
3	1	0	1	INACTIVE

No.	BDIR	BC2	BC1	Function
1	0	1	1	read from PSG
2	1	1	0	write to PSG
3	0	0	1	latch address
4	1	0	0	latch address
5	1	1	1	latch address

BDIR	BC2	BC1
PSGWR	A0	PSGRD

【プリント基板の改造】

　上記内容で改造したプリント基板の写真を貼っておきます。

　最初に改造後のプリント基板のトップ面です。PSGはなんとGI社製です。最初はAliExpressさんから購入した超安価＠６５円（送料別）を使っていましたが、動かなかったので40年程前に作った基板から抜き取り差し換えています。
　上記の改造後はAliExpressさんから購入したマイクロチップ社製のもの（本物かどうかは疑わしい）でも動作しました。
　未使用のゲートの入力ピンは両面でベタグランドにサーマルパッドで4点接続されているのでICのピンを折り曲げて丸ピンソケットで接続しています。

VDPSG基板トップ面

　改造後のVDPSG基板のボトム面が下の写真です。今回はPSG部分をブレッドボードで確認せずにプリント基板にしたので結構ジャンパー線が飛び交っています。
　PSGRD/とPSGWR/を反転して正論理にする際に、未使用のインバータ（HCT04）が1個しかなかったのでDRAMのリード信号のタイミング調整用に使っていた2個のインバータを未使用のアンドゲート（HC32）と入れ替えたことがジャンパー線が多くなった要因の一つです。

VDPSG基板ボトム面

　上記のGI社製PSGを抜き取った基板もおまけに貼っておきます。

昔作ったPSG基板

　抜き取ったGI社製PSG(40年程前に亜土電子で購入したもの)の写真も貼っておきます。

GI社製PSG

　AliExpressさんから購入した格安PSGの写真も・・・

MicroChip社製PSG

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タグ：PSG OriginalCPU TTL CPU Simple8Z 自作CPU オリジナルCPU Homebrew CPU TMS9918 AY-3-8910 Simple8VDPSG

2021-08-22 21:18 nice!(0) コメント(0)
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TOKYO2020オリンピックの思い出　 [日記]

　新型コロナにより1年延期した東京2020オリンピックが無事終了しました。
　今回のオリンピックはいつものオリンピックより多くの時間、テレビやネットを見て応援しました。

　鮮烈に印象に残った選手等をメモしておきます。

女子個人ロードレース　金メダリスト：キーゼンホーファー
　最初からアタックをかけ最後まで逃げ切り、2位の選手は自分が1位と確信してゴールしていたという快挙。
　ロードレースでは通常チームで戦うようだがチームに属さず単独で参加して、アマチュア（数学者）なのにプロ選手相手に金メダルを獲得した。

　下記は本人による談話です。
- 少ない人数で走った方が楽だから
- 私の代表選手を疑う人たちにも感謝。あなたが間違っていることを証明できることが私のモチベーションになる。
- ３０歳になり、何かを知っている人なんていないことを学んだ。なぜなら本当に何かを知っている人は「知らない」と言うからだ。
【リンク】
女子７０キロ級柔道　銅メダリスト：タイマゾワ
　金メダルを獲得した新井千鶴選手と準決勝で対戦した試合がすごかった。関節が信じられないくらい柔らかくて関節技を堪える精神力が凄い。
　12分にも及ぶゴールデンスコア（延長戦）の末に、最後は失神して勝敗が付くという壮絶さである。

【リンク】

その他
　今回のオリンピックで卓球の面白さを改めて知った（見ていて最も面白い競技の一つだ）。私が若いころは卓球クラブというと壁に向かって一人で練習しているようななんか暗いイメージがあったｗ。
　しかし、近代の卓球はラケットのラバーも進化し、チキータ等の新しい技も出てきていて、持ち技の切れや対戦相手に対する戦略と順応力を競う近代スポーツという印象だ。

　また、今回から競技種目として加わったスケートボードでは選手たちが国を超えてみんな友達のようにお互いを応援する姿には感銘を覚えた。
　加えて解説者の「半端ねえっす」等の言葉遣いも新しい時代の匂いがした。この言葉はtwitter情報では「パねぇ」の丁寧語だから解説者が使ってもいいとのことだ。

★追記　2021/08/21
　卓球　平野選手関連のリンクを追加（TOKYO2020以前のものも含む)
　超攻撃型高速卓球がすばらしい。

タグ：タイマゾワキーゼンホーファー TOKYO2020 オリンピック平野美宇

2021-08-18 15:59 nice!(0) コメント(0)
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TL866II用防塵キャップ　 [3D_printer]

　低価格で多機能なROM WriterであるTL886II Plusを久々に使ったところ、下図のようなエラーが発生してしまいました。
　ROMのピンとゼロプレッシャー（ZIF）ソケット間の接触不良のようでROMを何回か入れ直したらエラーが出なくなりました。

TL866IIで発生したエラー

　このROM Writerはページプリンタの上にずっと置いていたので上面に薄っすらと綿ゴミが積もったことが接触不良の一因かもしれません。

　そこでZIFソケットにゴミが積もらないようにカバーを作ってみました。

TL866IIのZIFソケット用カバー

　透明のPETGで出力し、実機に装着した様子が下の写真になります（色付きのフィラメントの方が良かったかも・・でも交換がめんどいｗ）

ZIFソケット用カバー装着状況

★追記　2021/08/19　{
　コネクタ部分のキャップも作ってみました。取り外し用の切り欠き（下図の下部）を下側にして装着します（逆でも問題ありませんが外観的に切り欠きが目立たない方がいい）。
　出力する際のフィラメントは柔軟性があり積層間の強度が高いPETGを推奨します。

TL866用コネクタキャップ（CAD)

　実機に装着した状態が下の写真です。
　コネクタの部分を塞ぐと放熱効果が低下しそうですが元々発熱が少ないので問題ないと思います（使用する場合は自己責任でお願いします）。

TL866用コネクタキャップ

}

　必要とする人はほとんどいないと思いますが、stlファイルを下記のリンクからダウンロードできます。商用利用以外であれば自由に使用可能です。

TL866Cover_v003_20210819.zip

★Ver0.03 2021/08/19　コネクタ部のキャップを追加
★Ver0.02 2021/08/14 文字パターンを「TL886」から「TL866」に修正

タグ：STL ソケットカバー TL866 TL866II Plus

2021-08-13 15:16 nice!(0) コメント(0)
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　⇒ GAME言語、懐かしいです。大..
　⇒ 　コメントありがとうございます..
　⇒ 懐かしいGAME言語ですね． ..
　⇒ GAMEソースの行番号をリナン..
　⇒ 　CP/M-80用GAME80..
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